【三重】回路設計（ポテンシャル）
スタンダード上場の大手アウトソーシング企業 (社名非公開求人)
- 正社員
- 未経験可
- 完全週休2日制
- 想定年収
- 350万円～400万円
- 勤務地
- 三重県
スタンダード上場／年間休日123日／”技術者”としてスキルアップ出来ます！
【職務詳細】
アナログ・デジタル回路設計／制御回路設計等お持ちのキャリアに合わせ業務をお任せします。
【案件例】
・輸送機器部品の制御コントローラ回路設計
・FPGA及びLSI設計開発
・伝送装置設計 等
■研修制度充実
回路製作、ハンダ付け、波形観測、電圧測定等々の基礎講習から半導体講習コース等専門的な研修まで多く取り揃えています。ベテランエンジニアの専任講師がおりますので、既存のカリキュラムには無い、個人のスキルアップ要望に沿った講座を開講することも可能です。
■働き方
勤務地希望可能で、自宅から通いやすい場所等、個人の事情に最大限寄り添うよう調整しています。
所定労働時間は7時間のため残業手当の比率が増え、給与水準も高くなります。
育休産休も取得実績があり、個人に合わせた働きやすい社風が特徴です。
未経験・第二新卒歓迎
会社の特徴
■「生涯技術者」が叶う環境です。
同社代表が技術者出身で、「技術者のための会社をつくりたい」との思いで創業したため、
会社が行う施策は常に「技術者のためになっているのか」といった観点で進められています。
■「社員満足度と顧客満足度は比例する」という信念のもと会社経営を行っています。
「1日実働7時間を超えた時点で残業扱い」「営業1人に対するエンジニアの数を調整して、じっくりとエンジニアにかかわれるように」
「自社での教育研修制度」「メンター制度」「サークル活動」など様々な取り組みを行っています。
募集要項
職種
【三重】回路設計（ポテンシャル）
応募資格
【必須】
・電気関連の知識がある方（電気・電子系を専攻していた方等、電気・電子設計の知見のある方）
・横浜本社にて1～3か月程度の研修参加が可能な方
【尚可】
・FPGA、Verilog-HDL、VHDL、DSP等の設計経験がある方
求める人物像
・セルフスターターな方
勤務地
三重県：案件先により異なる
勤務時間
9時00分～17時00分（所定労働時間7時間）
想定給与
350万円～400万円
■経験、スキル、年齢を考慮の上、同社規定により優遇
待遇/福利厚生
通勤手当、家族手当、住宅手当、寮社宅、退職金制度、自社内研修施設使用可能、通信教育制度、新車購入奨励金制度、社内表彰制度、財形年金、貯蓄、住宅傷害保険、所得補償補選、生命保険団体扱い、社宅制度、社員持株会、相助会、サークル活動、イベント開催
休日/休暇
【年間休日123日】完全週休2日制（土日祝）、GW、夏季休暇、年末年始、有給休暇、慶弔
雇用形態
正社員
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