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募集要項
職務概要LSIやFPGA等の半導体開発を行っていただきます。
職務詳細■ RTL設計
■テストベンチ
■各種検証業務
言語：Verilog-HDL、VHDL
ツール： Synopsys、Cadence社製シミュレーター（VCS、NC-Verilog等）
※様々な業務を行っていますので、
一人ひとりのスキルやご経験に合わせて、業務を担当して頂きます。
★技術のエキスパートとして、開発実務に携わって頂きます。
今まで培われた知識・技術スキルを活かして様々な製品・プロジェクトに関わることが出来ます。
同社について社長は半導体のエンジニア出身。現場を知っているからこそ、同社を
「ただ使う、使われるの関係ではなく、顧客に入り込んで信頼を
勝ち取れる存在にしたい」と考えており、その考えは社内にも
浸透しています。希望に応じた案件をアサインしてくれる企業です。
会社の特徴
同社はハードウェア・ソフトウェアの開発に対応できる技術を持っているのが特徴です。
そのため、お客様のニーズに合わせて両面からシステムの提案、ソリューション開発を提供しています。
ハードウェアでは、LSI、FPGAといった半導体の設計、開発に強みを持っており、
上流工程から下流工程まで一連の開発に対応しています。
また、最先端のプロセスや最新のEDAツールを用いての開発にも対応が可能です。
ソフトウェアでは、組込み・制御系ソフト開発を中心に業務系（WEB）システム開発にも対応しています。
フェーズとしては、システムエンジニア業務から、プログラマー業務、テストまで幅広く対応しています。
- 職種
- 【神奈川】LSI開発・論理回路設計
- 応募資格
- 【必須】
■半導体開発経験
■Verilog-HDL、VHDLいずれかの経験
【環境】
■客先常駐業務がほとんどであるため、メンバーが頻繁に顔を
合わせることはありませんが、社長や取締役も交えて
年1回スポーツ大会を実施するなど、交流も盛んです。
■勤続3年以上の方から勤続年数に応じた退職金が支払われます。
不安定な業界だからこそ、「少しでも安心して勤務できる環境を！」
との思いから退職金制度を設けています。
- 求めるスキル
- 自主的に関われる方
- 勤務地
- 神奈川県内※案件により異なる
- 勤務時間
- 9時00分～18時00分
- 想定給与
- 300万円～550万円
■経験、スキル、年齢を考慮の上、同社規定により優遇
- 待遇/福利厚生
- 交通費支給（上限5万円）、残業手当、職務担当手当、帰省旅費、住宅手当（転勤者のみ）、資格取得補助、図書購入補助
- 休日/休暇
- 【年間休日124日※前年】週休2日制（土・日）、有給休暇（入社後6ヶ月で支給）、慶弔休暇、夏季休暇、年末年始休暇、GW
- 雇用形態
- 正社員
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会社情報
- 会社名
- 株式会社D-design
- 事業内容
- 【ハードウェア・ソフトウェア分野におけるアウトソーシングサービスの提供、及び受託開発】■LSI・FPGAの設計開発■組込み・制御系、業務系・WEB系システムの設計、開発、評価、試験
- 本社所在地
- 大阪府大阪市北区梅田1-2-2 大阪駅前第2ビル11階
- 設立年
- 2008年11月
- 従業員数
- 130名
- 資本金
- 5，000万円
- 平均年齢
- 40歳
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