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【神奈川】スタンダードセルIP開発エンジニア／ユナイテッド・セミコンダクター・ジャパン株式会社

【神奈川】スタンダードセルIP開発エンジニア

ユナイテッド・セミコンダクター・ジャパン株式会社

正社員
完全週休2日制

想定年収: 500万円～1000万円

勤務地: 神奈川県

日本最大級のロジックLSI製造能力保有！／グローバル展開中！

【職務概要】
同社にて下記業務をおまかせします。

【職務詳細】
・デジタル回路設計で基本となるスタンダードセルの開発
・スタンダードセルの設計及び各種EDAライブラリ開発
・スタンダードセルのレイアウト，設計フロー，サインオフ等の開発／設計

【働きやすさ】
世の中を豊かにしていく原動力となる社員一人ひとりの「働きやすさ」の実現のため、さまざまな福利厚生や社内制度を設けています。

＜一例＞
・離職率2％
・休暇制度：積立休暇、リフレッシュ休暇、慶弔休暇　など
・育児関連制度：出産育児サポート休暇、育児休職制度、育児短時間勤務制度、ベビーシッター費用補助

会社の特徴

同社は、グローバルにビジネスを展開する本格的なファウンドリ（半導体の受託製造）専業会社として、2014年12月に誕生した会社です。
人材や技術を駆使して、ウェアラブル・モバイル端末向けの超低消費電力技術や、
自動車用の高品質フラッシュメモリ混載技術など先端テクノロジーを実現させています。
同社にはトップクラスの「不揮発メモリ混載プロセス」のプラットフォーム、さらにはRFやミリ波技術といった車載市場やIoT市場に最適なテクノロジーがあります。また、きめ細かい生産管理、経験豊富なエンジニア、たゆまぬ生産改善活動による強固な生産体制、ハイブリッド免震建屋やLNG基地などの高いリスク対応能力が同社の強みです。
世の中が求める技術と品質で、豊かで夢のある未来を世界中の人々にお届けしています。

募集要項

職種

【神奈川】スタンダードセルIP開発エンジニア

応募資格

【必須】
・スタンダードセルの開発経験
・トランジスタレベルの回路設計の実務経験(Cadence schematic editor／Synopsys HSpice等)
・トランジスタレベルのマニュアルレイアウトの実務経験(Cadence Virtuoso／Siemens Calibre等)

【尚可】
・ビジネス英語使用経験
・英語読解力
・アナログ回路設計，デジタル回路設計
・スタンダードセルの回路設計，キャラクタライズ， EDAライブラリの生成
・Chip設計全般の知識，経験(Physical verification， DFT， Timing closure， IRDrop／EM analysis／P＆R)