株式会社テクノプロ テクノプロ・デザイン社

【山梨】回路設計(FPGAスペシャリスト)

  • 想定給与 560万円~1000万円
  • 山梨県
  • 正社員

◆充実の資格手当/東証プライム上場グループ/年間休日123日/寮・社宅制度あり◆

職務概要同社では、顧客基盤であるメーカーに対して、製品開発支援と共に様々な課題解決を行うことができる独自のポジションを築いております。AI・IoT・DXの活用が急速に進む中で、電子回路の高性能化も強く求められています。
今回は豊富な経験を活かし、開発実務に携わっていただけるFPGAスペシャリストとして以下業務をお任せします。
職務詳細同社のお客さま(家電/医療/センサ等に関係する大手半導体メーカー)の開発現場及び自社開発センターでFPGA設計エンジニアとして開発業務に従事していただきます。
<案件事例>
液晶モニターのFPGA開発/半導体製造装置のFPGA開発/通信制御用基板におけるFPGA開発/信号処理装置のFPGA開発/画像処理装置のFPGA開発/医療用機器のFPGA開発/イメージセンサーのFPGA開発
その他日本最大級のエンジニア集団である同社。
充実の福利厚生・待遇で、みなさまをしっかりとサポートします! 会社の特徴 東証プライム上場の同社ホールディングスのグループ会社で、
自動車、家電、航空機、宇宙などのものづくり分野に強いエンジニアリング企業です。
大手メーカー・上場企業を中心に800社以上の取引先企業から日々オファーがあります。
大きな信頼を得ている理由は、同社の従業員のうち約7,000名にのぼるエンジニアが持つ「技術力」の高さにあります。
「社会を動かすエンジニア集団」として、航空機/医療機器/自動車/家電/精密機器をはじめとする
様々な業界/顧客への技術提供を行っているなかで、エンジニア向けに技術研修やリーダー・マネージャー研修、勉強会などを
多彩に取りそろえ、クライアントに妥協のない、こだわりの技術を提供できるように体制を整えています。

募集要項

職種
【山梨】回路設計(FPGAスペシャリスト)
応募資格
【必須】
・設計経験が1年以上ある方 
 (FPGAの設計、VerilogHDL あるいは VHDLでの設計) 

【尚可】
・リーダー経験
・SystemVerilog SystemCでの設計経験
必要な経験スキル
・セルフスターターな方
勤務地
※プロジェクト先により異なる
勤務時間
9時00分 ~ 18時00分
想定給与
560万円~1000万円
■経験、スキル、年齢を考慮の上、同社規定により優遇
待遇/福利厚生
通勤手当(上限15万円/月)、残業手当(1分単位)、退職金制度、役職手当、赴任手当(8万円/月)、出張手当、帰省旅費(月1回)、資格手当、寮社宅制度(独身寮:個人負担2万円/家族寮:個人負担~3万円)、引越し費用補助、資格取得補助、通信教育補助、社内外講習補助、勉強会講師料補助
休日/休暇
【年間休日123日】週休2日制(土日)、年末年始休暇、夏季休暇、慶弔、
有給休暇、特別休暇、出産・育児・マタニティ休暇、入社時特別休暇
雇用形態
正社員

会社概要

会社名
株式会社テクノプロ テクノプロ・デザイン社
事業内容
機械、電気、電子、組込制御における研究開発分野/商品開発分野への技術サービス、データ分析/コンサルティング/国内外の自動車・航空機/鉄道/医療機器等、大手メーカーの研究/製品開発の受託/請負/派遣
本社所在地
〒106-6135 東京都港区六本木6-10-1 六本木ヒルズ森タワー35F
設立年
1997年6月
従業員数
7,820名(2022年6月末時点)
資本金
1億円
売上高
【売上高】
576.7億円(2022年6月期)
939億円(2018年6月期)
836億円(2017年6月期)
平均年齢
37歳

採用選考ポイント

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