【プライム上場G】大手メーカーでのプロジェクト／一連の設計フローに携われます！
募集要項
職務概要同社の顧客先にて、デジタル回路設計を担当していただきます。
■製品：CMOSイメージセンサーにおけるLogicBEおよびクロックブロック
■範囲：RTL設計～検証
■ツール：
・物理インプリ実装ツール：Design Compiler、Formality、PrimeTime
・HDLシミュレータ：IUS・チェッカー
・検証ツール：Spyglass Checker、SpyglassCDC、JasperGold、Verdi
・設計言語：Verilog-HDL
・関連スキル領域：半導体回路、ロジック回路、IC回路設計に関する知識、C言語／Python等のスクリプティング言語
職務詳細・LogicBE、クロックブロックのRTL設計・論理仕様策定
・design compilerを用いた論理合成
・SDC（物理インプリ制約）を作成し、タイミング制約を定義
・primetimeによるタイミング解析 ・formalityを用いた論理等価性検証
・Spyglass Checker、SpyglassCDCによる構文チェック
・非同期検証（CDC検証） ・JasperGoldによるフォーマル検証
・Verdiによる波形デバッグ
・インプリ部門との仕様調整・課題対応窓口
会社の特徴
【同社について】エンジニア派遣、製造派遣、人材紹介、製造請負、教育受託の各事業に取り組んでおり、クライアントニーズに応じた多様なサービスを
展開しております。国内外の大手メーカーを中心に4，000社以上の取引先を有しており、全国に56拠点と9か所の研修施設を展開しています。
【業界地位】製造系人材サービスのパイオニア的存在として、創業以来産業界と労働市場の発展に貢献してきました。
国内市場におけるシェアは高く、特に製造派遣や製造請負においては強固な地位を築いております。
【経営ビジョン】「人を育て 人を活かす」という創業理念のもと、人材育成と職場形成に重きを置いております。
人は無限の可能性を持っており、教え、「場」を提供することでその可能性を最大限引き出すことを社会への使命と考えております。
- 職種
- 【神奈川】デジタル回路設計（CMOSイメージセンサー）
- 応募資格
- 【必須】
・物理インプリ実装ツール（Design Compiler、Formality、PrimeTime）に関する知見をお持ちの方
・クロック・リセット制御回路およびDFT設計に関する知見をお持ちの方
・半導体のデジタル回路設計スキルをお持ちの方
・Verilog-HDLによる設計・検証スキルをお持ちの方
【尚可】
・CMOSイメージセンサーに関する基礎知識をお持ちの方
- 求めるスキル
- ・他チームと連携しながら設計・商品化を主体的に遂行できる方
・他チームメンバーと柔軟にコミュニケーションを取れる方
- 勤務地
- 神奈川県厚木市のプロジェクト先
※配属先により異なる
- 勤務時間
- 9時30分～18時00分 ※配属先により異なる
- 想定給与
- 400万円～700万円
■経験、スキル、年齢を考慮の上、同社規定により決定
- 待遇/福利厚生
- 資格取得助成金制度、慶弔見舞金制度、総合福祉団体定期保険支給制度、従業員持株会制度、提携保養所、退職金制度（確定給付型企業年金・確定拠出型企業年金）、技術手当、住宅手当（規定あり）
- 休日/休暇
- 【年間休日125日 ※配属先により異なる場合があります。】完全週休2日制(土・日・祝)、年次有給休暇（半休制度有）、GW、夏期休暇、年末年始休暇、
産前産後休暇、育児休暇、介護休暇、子の看護休暇、結婚休暇、子女結婚休暇、忌引き休暇、公務休暇
- 雇用形態
- 正社員
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会社情報
- 会社名
- 日総工産株式会社
- 事業内容
- ■製造業務全般に関する業務委託、業務請負事業■製造業務全般に関する一般労働者派遣事業、有料職業紹介事業
- 本社所在地
- 〒222-0033
神奈川県横浜市港北区新横浜1-4-1 日総工産新横浜ビル
- 設立年
- 1971年2月3日
- 従業員数
- 3，250名
- 資本金
- 100百万円
- 売上高
- 87，330百万円（2025年3月期）
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